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EDA用VHDL语言设计一个2-4译码器

3,504阅读 60顶 5人收藏 1页yuananong上传 举报/认领 展开

本文档由 yuananong 分享于2010-04-27 18:46

EDA用VHDL语言设计一个2-4译码器，的小程序。是利用CASE语句实现的。
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.doc
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1页
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IT计算机  —  网络与通信
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文档标签：
译码器 EDA VHDL 语言
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译码器 vhdl eda 语言 sel logic
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