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EDA课程设计之含异步清0和同步时钟使能的加法计数器

1,656阅读 13顶 5人收藏 1页huiyirushi上传 举报/认领 合伙人(招募中) 展开

本文档由 huiyirushi 分享于2010-06-08 22:49

实验目的：学习计数器的设计、仿真和硬件测试，进一步熟悉VHDL设计技术
文档格式：
.doc
文档大小：
29.0K
文档页数：
1页
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5
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文档分类：
IT计算机  —  软件工程
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文档标签：
EDA 实验 加法
系统标签：
计数器 时钟 加法 cqi eda 异步
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