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多重级联奇偶
校验码
的FPGA实现
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大连海事大学硕士学位论文多重级联奇偶校验码的FPGA实现姓名:陈玉飞申请学位级别:硕士专业:通信与信息系统指导教师:岳殿武20080301中文摘要摘要自1948年香农提出并证明了著名的有扰信道编码定理
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校验码
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校验码
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校验码
+海明
校验码
+循环冗余
校验码
)
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CRC
校验码
编码过程
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CRC校验码编码过程
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CRC冗余
校验码
的仿真
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计算机与通信学院2013年秋季学期 计算机通信 课程设计 目:(13,9)CRC冗余校验码的编译码仿真实现 专业班级: 在当今高度信息化的社会,信息和通信已成为现代社会的“命脉”,在信息传递过程中往往
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低密度
校验码
的设计及应用
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低密度校验码(LDPC,Low-Density Parity-Check Codes)的诞生和发展使人们更加接近以逼近Shannon限的有效功耗实现可靠通信的目标。LDCP码是当今信道编码领域最受瞩目的研究热点之一。
本文作者结合国家863项目和Philips公司等科研项目,采用理论分析和计算
机仿真相结合的方法,对LDPC码的几个关键问题进行了研究。主要完成的工作
有以下几个方面:
系统地介绍了LDPC码的译码原理;推导了不同测度下LDPC码各种译码算
法的消息迭代更新公式。
在分析不同消息空间密度进化特点的基础上,应用密度进化理论优化度序列
分布,给出了LDPC码度序列的搜索方法,并给出了码设计和性能仿真结果;对
循环码和LDPC码的串行级联系统进行分析和计算机仿真,给出了不同译码算法
下串行级联系统的性能,并给出了适合硬件实现的串行级联软检测算法。
关键词:LDPC码消息传递算法密度进化串行级联系统
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基于FPGA的循环冗余
校验码
的实现
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目前,我国基于FPGA的循环冗余校验码的实现系统刚刚起步,所以研究并开发一种基于FPGA的循环冗余校验码的实现系统具有很大的工程实际意义。
李萧萧
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