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标签： FCLK HCLK PCLK 2410 的时钟和电源管理 关于 3C2440 FCLK, HCLK, PCLK 的关系（转载） ADS1.2 中关于时钟的 C 代码 ChangeMPllValue((mpll_val>>12)&0xff, (mpll_val>>4)&0x3f, mpll_val&3); ChangeClockDivider(key, 12); 1）FLCK、HCLK 和 PCLK 的关系 S3C2440 有三个时钟 FLCK、HCLK 和 PCLK s3c2440 官方手册上说 P7-8 写到： FCLK is used by ARM920T，内核时钟，主频。 HCLK is used for AHB bus, which is used by the ARM920T, the memory controller, the interrupt controller, the LCD controller, the DMA and USB host block. 也就是总线时钟， 包括 USB 时钟。 PCLK is used for APB bus, which is used by the peripherals such as WDT, IIS, I2C, PWM timer, MMC interface,ADC, UART, GPIO, RTC and SPI.即 IO 接口时钟，例如串口的时钟设置就是 从 PCLK 来的； 那么这三个时钟是什么关系呢？ 这三个时钟通常设置为 1:4:8，1:3:6 的分频关系，也就说如果主频 FLCK 是 400MHz，按照 1:4:8 的设置，那么 HLCK 是 100MHz，PLCK 是 50MHz 寄存器 CLKDIVN 表明并设置了这三个时钟的关系 如果 CLKDIVN 设置为 0x5,那么比例即为 1:4:8，前提是 CAMDIVN[9]为 0. 2）输入时钟 FIN 与主频 FCLK 的关系 现代的 CPU 基本上都使用了比主频低的多的时钟输入，在 CPU 内部使用锁相环进行倍频。 对于 S3C2440，常用的输入时钟 FIN 有两种：12MHz 和 16.9344MHz，那么 CPU 是如何将
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