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实现了32位浮点乘法器。。。。。
为了提高性能,整段代码都尽量采用连续赋值语句assign。
该段代码已经经过严格测试,目前来看还是非常可靠的。
使用说明:
在rst为1的情况下,每次load 来一个高脉冲,后10个时钟周期就开始计算,10个周期后出结果。时序参照下图,我用的是modelsim,乘数都是0.5。
Mentor公司的ModelSim是业界最优秀的HDL语言仿真软件,它能提供友好的仿真环境,是业界唯一的单内核支持VHDL和Verilog混合仿真的仿真器。它采用直接优化的编译技术、Tcl/Tk技术、和单一内核仿真技术,编译仿真速度快,编译的代码与平台无关,便于保护IP核,个性化的图形界面和用户接口,为用户加快调错提供强有力的手段,是FPGA/ASIC设计的首选仿真软件。
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